思特威电子
岗位信息
招聘岗位
FPGA工程师【27届校招】
工作城市
上海
学历要求
硕士
是否笔试
未明确
招聘批次
校招
截止日期
未公布（以企业官网为准）
发布日期
2026-08-07
📋 岗位职责 / 任职要求
岗位职责
1. 负责基于FPGA的AI计算、数据处理及系统加速功能开发；
2. 负责高速数据采集、传输、缓存及接口控制等逻辑设计与功能验证；
3. 参与计算设备间高速通信、数据搬运及异构协同相关功能开发；
4. 负责FPGA模块集成、板级调试、时序分析、资源优化及性能测试；
5. 编写和维护设计说明、接口文档、测试报告及其他相关技术文档。
任职要求
1. 电子、通信、计算机、自动化等相关专业，硕士研究生及以上学历；具有优秀项目经历的本科生亦可；
2. 熟练掌握Verilog或SystemVerilog语言，熟悉数字电路设计、仿真验证及时序分析方法；
3. 熟悉至少一种主流FPGA平台及相关开发工具，掌握FPGA设计、综合、布局布线和调试流程；
4. 熟悉PCIe、DDR、以太网、SerDes等高速接口，了解I2C、SPI、UART等常用接口；
5. 有高速数据传输、DMA、网络通信、计算加速或板级调试相关项目经验者优先，具备良好的团队协作和英文阅读能力。
🏢 企业简介
总部上海
思特威电子是国内领先的CMOS图像传感器芯片设计企业，专注于高性能成像技术的研发与创新，产品广泛应用于安防监控、机器视觉、智能车载电子及消费类物联网等领域。公司作为民营集成电路设计企业，总部位于上海，在苏州设有研发与运营布局，依托长三角集成电路产业优势持续扩张。在图像传感器赛道，思特威凭借自研像素技术与系统级方案构建起扎实的行业地位，业务覆盖全球主流客户。当前在上海、苏州同步开放校园招聘，面向微电子、计算机、算法等方向的应届生提供芯片设计、图像处理、软硬件开发等核心岗位，技术栈紧贴AIoT与智能感知前沿，研发体系完善、晋升通道清晰，适合希望在国产半导体赛道长期成长的毕业生加入。
投递方式
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🎯 AI校招画像 （来源：公开信息智能整理）
🏢 公司文化与工作氛围
科创板上市芯片设计公司，技术氛围浓厚，扁平化管理，团队年轻有活力，强调创新和技术深度。
⏰ 加班情况与工作强度
芯片设计行业项目制，流片节点前压力较大，整体节奏适中偏快，15薪和股权激励与业绩挂钩。
💰 薪资待遇与年终奖
数字IC设计硕士25-30万/年，像素研发硕士20-30万/年，版图/测试本科15-20万/年，15薪，模拟设计社招30-45K·15薪。
🎁 福利体系
五险一金、补充医疗保险、子女医疗保险、带薪年假、年终奖金、股票期权、项目奖金、定期体检、零食下午茶、定期团建。
📋 校招流程经验
网申→笔试（专业基础）→2-3轮技术面试→HR面→Offer。9月起陆续启动，滚动招聘。
🚀 投递建议与避坑指南
微电子/集成电路/电子工程相关专业优先，笔试侧重半导体物理、模电数电、Verilog/版图基础。面试考察项目深度和技术基础，有流片经验或相关竞赛获奖者优先。
👥 员工口碑与离职率评价
公司在CIS赛道地位领先，上市后发展稳健，技术成长空间大，上海闵行办公。芯片设计行业薪资有竞争力，流片压力是主要挑战。
📈 热门岗位方向与招聘趋势
2027届校招规模稳定，车载CIS和机器视觉方向需求增长。AI视觉和智能驾驶带动CIS芯片持续需求，公司积极布局高端市场。
ℹ️ 信息来源
本条招聘信息由校招宝转载自 企业校招官网，版权归原发布方所有，校招宝仅作信息聚合与导航。
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